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免费下载设计-基于FPGA的等精度频率计的设计与实现

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资料简介
设计 基于FPGA的等精度频率计的设计与实现 共21页,6989字
目录
前言...............................................................1
第一章 FPGA及Verilog HDL..........................................2
1.1 FPGA简介.....................................................2
1.2 Verilog HDL 概述.............................................2
第二章 数字频率计的设计原理........................................3
2.1 设计要求.....................................................3
2.2 频率测量.....................................................3
2.3.系统的硬件框架设计..............................................4
2.4系统设计与方案论证............................................5
第三章 数字频率计的设计............................................8
3.1系统设计顶层电路原理图........................................8
3.2 频率计的VHDL设计.............................................9
第四章 软件的测试............... ................................15
4.1测试的环境——MAX+plusII.....................................15
4.2调试和器件编程...............................................15
4.3频率测试.....................................................16
摘要: 本文详细介绍了一种基于FPGA的高精度频率计。首先论文概述了等精度测量频率的原理,该原理具有在整个测试频段内保持高精度频率测量的优点。对于频率测量的一些主要参数、技术进行了讨论。同时在该原理基础上,利用VHDL语言设计实现频率计内部功能模块;采用AT89S52单片机进行数据运算处理,利用液晶显示器对测量的频率、占空比等进行实时显示,可读性好;还使用C语言设计了该等精度频率计的主控程序以提高测量精度。充分发挥FPGA的高速数据采集能力和单片机的高效计算与控制能力,使两者有机地结合起来。在MUX+PULSⅡ EDA(电子设计自动化)开发平台上进行仿真、测试、并最终下载到FPGA芯片内部。本设计实现了对频率变化范围较大的信号进行频率测量,能够满足高速度、高精度的测频要。文章的最后总结了整个系统的性能和特点,提出了值得进一步研究和优化的地方,并展望了其应用前景。利用等精度测量原理,通过FPGA运用VHDL编程设计一个数字式频率计,精度范围在DC~100 MHz,给出实现代码和仿真波形。设计具有较高的实用性和可靠性。
关键词:FPGA;等精度;频率计;VHDL
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